数字逻辑 资源专区

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VHDL多路复用器示例

A Mux example written in VHDL.

VHDL 多路复用器 数字逻辑

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VHDL优先编码器

Priority encoder in VHDL.

VHDL 优先编码器 数字逻辑

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VHDL 0-9计数器带按钮控制

CODE_VHDL_COUNTING 0 到 9，使用按钮 (Đếm 慈 0 đến 9 hiển 施耐 1 带领 7 đoạn sử dụng nút nhấn để điều

VHDL 计数器 按钮控制

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VHDL 0-9 计数器与七段显示

此VHDL源码资源提供了一个实现0到9自动计数并在一个七段显示器上显示的数字逻辑设计。该设计采用VHDL硬件描述语言编写，适用于需要进行数字显示和基本计数功能的嵌入式系统或FPGA

VHDL 计数器 七段显示

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VHDL 0-9 计数器与七段显示驱动

CODE_VHDL_COUNTING 0 到 9 (慈 0 đến 9 Đếm hiển đoạn 施耐 1 带领 7)

VHDL 计数器 七段显示

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基于VHDL的四脉冲计数器与三按钮控制

VHDL_COUNTING 与 4 使脉冲和使用 3 按钮了，下来，停止 （Mạch đếm với 4 xung ENA sử dụng 3 nút nhấn lên，xuống

VHDL 计数器 按钮控制

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VHDL 0-9999 四位七段 LED 计数器

VHDL_count 从 0000 到 9999 7 段 LED 显示器 （đếm 慈 0000 đến 9999 hiển 施耐 4 领导 7 đoạn）

VHDL 计数器 七段LED

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VHDL LED右至左逐点亮控制

VHDL LED右至左逐点亮控制是一个用于FPGA或CPLD等可编程逻辑器件的VHDL代码示例，其核心功能是实现LED灯从右向左逐个点亮的效果。这个资源提供了一个基础的数字逻辑设计

VHDL LED控制 FPGA

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VHDL按钮控制计时器

VHDL_COUNTING 时间使用按钮 (Đếm giờ phút giây sử dụng nút nhấn)

VHDL 计时器 按钮控制

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基于Verilog的CPLD出租车计费器源码

用verilog写的基于cpld的出租车计费器的源码，需要的参考一下-Use verilog to write a taxi based cpld billing device s

Verilog CPLD 出租车计费器

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4线-2线编码器与优先编码器

数字逻辑基础篇05：4线-2线编码器  优先编码器 数字逻辑基础篇05：4线-2线编码器  优先编码器

数字逻辑 编码器 优先编码器

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LED与按键验证与非门

数字逻辑基础篇02：利用LED和按键验证与非门 数字逻辑基础篇02：利用LED和按键验证与非门

数字逻辑 与非门 LED

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