数字逻辑 资源专区

本专区汇聚了各类基于 数字逻辑 开发的源码资源,共计 321 篇资源供开发者免费下载学习。

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Verilog七段数码管显示控制器

基于xilinx公司的basys3做的项目,利用一个拨码开关控制,开关状态分别正序倒序显示1234

Verilog FPGA 七段数码管
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基于移位寄存器的六灯跑马灯

跑马灯-是移位寄存器 有6个灯,无延时entity-Bomadeng-shift register is a six lights, without delay entity

跑马灯 移位寄存器 数字逻辑
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110三位探测器VHDL描述与实验报告

一个简单的探测110三位的探测器,用逻辑图和vhdl描述,包括实验报告和测试图。-a simple survey of 110 three detectors, and a log

VHDL 数字逻辑 探测器
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Quartus II 5.1 四位加法器 HDL 源码

adder4 hdl ok in Quartus II 5.1

四位加法器 HDL Quartus II
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不同算法的硬件实现

Regarding the hardware implementations of different algorithms

硬件实现 算法 数字逻辑
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8位Booth乘法器VHDL源代码

8位有符号编码的整数基改性

VHDL Booth乘法器 数字逻辑
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基于Verilog的串口收发协议设计

基于verilog的串口收发程序,使用组合逻辑加时序逻辑的方式编写,易于灵活修改!

Verilog 串口 UART
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基于Verilog的自动售货机控制器设计

应用背景这里的目标是设计自动售货机控制器接受资金投入(我和)在任何序列,并提供产品时所需的量已沉积并给出了改变。在这里向用户提供附加设备。这是可以撤回的如果客户希望通过按一个按钮的

Verilog 自动售货机 数字逻辑
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VHDL实现自动售货机(毕业设计参考)

用VHDL实现自动售货机,可供毕业设计参考。可以输入硬币和纸币,硬币的识别范围是5角和1 元的硬币,纸币的识别范围是1 元、5 元,10 元,20元,50元,100元。可以连续多次

VHDL 自动售货机 毕业设计
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8位Booth乘法器Verilog代码

展位的乘法算法是将在两个的补充符号两个符号二进制数字相乘的乘法算法。展位的算法可以通过反复添加 (与普通的无符号二进制加法) 两个预设值 A 和 S P,然后对体育执行算术右移产品

Verilog Booth乘法器 数字逻辑
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完整版乘法器源码

完整版的乘法器.相信对初学者有不小的提高-The full version of the multiplier. I believe there is not a small im

乘法器 数字逻辑 算法
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基于Verilog的状态机序列检测器

利用状态机编写一个序列检测器,可以依照思路修改需要检测的序列!

Verilog 序列检测器 状态机
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