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这是维特比译码器 verilog 代码生成器进行测试和 FPGA 验证。
应用背景从信息理论和错误控制编码314，罗伯托博士托内利关键技术西澳大利亚大学的差错控制码（信道编码）
海明码的程序， 可以用这个程序来实现二进制数的校验，-Hamming code of procedure, this procedure can be used to achiev
FEC的原理实现，可参考学习和应用。前向纠错也叫前向纠错码(Forward Error Correction，简称FEC)，是增加数据通讯可信度的方法。在单向通讯信道中，一旦错误被
自己写的Viterbi Decoder 可以解码 213 417 码率-Viterbi decoder for 213 417 code rate
hamming code generator and checker
基于VHDL语言的循环码编码器的程序，以一个（15，6）循环码为例-VHDL language based on the cycle of the program code enc
32bit/64bit EDAC源代码 用于提高可靠性设计，可实现纠一位错误检两位错误-source VHDL for 32bit/64bit EDAC
(7，4)汉明码的编码程序，实现4位信息位后加三位监督位，组成7位码组-(7,4) hamming code encoding process, realize informati
基于VHDL语言的汉明码的译码，含有校正子跟纠错检错功能-Based on the VHDL language decoding Hamming Code, which conta
单片机汉明码解码程序，8-4编码，接收从串口发送过来得数据-Hamming code decoding process Singlechip ,8-4 encoding, rece
单片机汉明码编码程序，8-4编码，编码后得数据通过串口发送出去-Singlechip hamming code encoding process ,8-4 encoding, th